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集成電路設(shè)計(jì)

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集成電路設(shè)計(jì)

ddswolf創(chuàng)建于2011-12-06 最后編輯: 2011-12-29 22:58 2.25W閱讀 9人收藏
詳細(xì)介紹了集成電路設(shè)計(jì)階段使用的技術(shù)文檔，適合初學(xué)
共 40 個(gè)文檔
波形發(fā)生器新型集成電路ICL8038及XR—2206 5p
pdf 波形發(fā)生器新型集成電路ICL8038及XR—2206
波形發(fā)生器新型集成電路ICL8038及XR—2206
  • 作者: ddswolf
  • 2011-12-27
  • 格式: PDF
PT_S13W1_09 34p
ppt PT_S13W1_09
PT_S13W1_09，synopsys，時(shí)序分析，primetime，PT
  • 作者: ddswolf
  • 2011-12-27
  • 格式: PPT
verilog7 29p
ppt verilog7
數(shù)字電路設(shè)計(jì)，verilog，hdl，vhdl
  • 作者: ddswolf
  • 2011-12-27
  • 格式: PPT
PT_S13W1_08 20p
ppt PT_S13W1_08
PT_S13W1_09，synopsys，時(shí)序分析，primetime，PT
  • 作者: ddswolf
  • 2011-12-27
  • 格式: PPT
全球10大半導(dǎo)體廠詳解 17p
doc 全球10大半導(dǎo)體廠詳解
暫無(wú)描述
  • 作者: ddswolf
  • 2011-12-07
  • 格式: DOC
PT_S13W1_00 38p
ppt PT_S13W1_00
PT_S13W1_09，synopsys，時(shí)序分析，primetime，PT
  • 作者: ddswolf
  • 2011-12-27
  • 格式: PPT
FPGA設(shè)計(jì)流程 6p
doc FPGA設(shè)計(jì)流程
暫無(wú)描述
  • 作者: ddswolf
  • 2011-12-07
  • 格式: DOC
PT_S13W1_07 35p
ppt PT_S13W1_07
PT_S13W1_09，synopsys，時(shí)序分析，primetime，PT
  • 作者: ddswolf
  • 2011-12-27
  • 格式: PPT
邏輯分析儀介紹 23p
doc 邏輯分析儀介紹
暫無(wú)描述
  • 作者: ddswolf
  • 2011-12-07
  • 格式: DOC
JTAG技術(shù)詳解 9p
doc JTAG技術(shù)詳解
暫無(wú)描述
  • 作者: ddswolf
  • 2011-12-07
  • 格式: DOC
驅(qū)動(dòng)開(kāi)發(fā)學(xué)習(xí)筆記 14p
doc 驅(qū)動(dòng)開(kāi)發(fā)學(xué)習(xí)筆記
暫無(wú)描述
  • 作者: ddswolf
  • 2011-12-07
  • 格式: DOC
verilog1-2 56p
ppt verilog1-2
數(shù)字電路設(shè)計(jì)，verilog，hdl，vhdl
  • 作者: ddswolf
  • 2011-12-27
  • 格式: PPT
PT_S13W1_04 14p
ppt PT_S13W1_04
PT_S13W1_09，synopsys，時(shí)序分析，primetime，PT
  • 作者: ddswolf
  • 2011-12-27
  • 格式: PPT
硬件筆試題.doc.C12B03B048EA60F03D3A7DD7E6D29501.20111109122336 2p
wps 硬件筆試題.doc.C12B03B048EA60F03D3A7DD7E6D29501.2011..
暫無(wú)描述
  • 作者: ddswolf
  • 2011-12-06
  • 格式: WPS
PT_S13W1_03 27p
ppt PT_S13W1_03
PT_S13W1_09，synopsys，時(shí)序分析，primetime，PT
  • 作者: ddswolf
  • 2011-12-27
  • 格式: PPT
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